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VerlogでA/Dコンバータ、その4

実際に回路を、作るにあたり積分器をRCだけで済ますことはできるでしょうか?
電圧入力のRC積分器の出力は,時定数をτとすると、

Error


概算では、x<=0.0005となります。したがって、時定数の0.05%くらいならよいようです。
このとき、積分器の出力は 0.0005・E

5V系のディジタル回路で、考えると約1mVくらいになるでしょうか?これなら、なんとかなりそうな気がします。
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本日の御託
さるTV番組で、「ブルドーザー」の語源を解説していた。ブルドーザーの発明以前は、牛(=Bull)に引かせて整地を行っていたのが、発明以降は昼寝(=doze)をするほどヒマになる、という意味だそうである。猫いらずみたいなものか?



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